CPLD程序求助：到fit这一步编不过去了

初学CPLD，编个接收1553B数据的小程序。前面综合，翻译都通过了，就是到映射过不去，编译的结果总是报同样的错误，如下：Mapping a total of 236 equation into 16 function blocks
Error:CPLD:892  Cannot place signal init_reg<1>.Consider reducing the collapsing input limit or the product term limit to prevent the fitter from creating high input and / or high product term functions.

CPLD:868 Cannot fit the design into any of the soecified devices with the selected implementation options.

注：init_reg<1>是我定义的一个中间信号。先前编译的时候是报另一个中间信号dout<6>存在这类错误，因dout信号与一个双向端口有关系，对双向端口增加了一个三态的信号的处理，后来再编译就换成init_reg<1>这个信号有错了。

这两个错误到底什么意思呢？怎么改呢？请高手指教，不胜感激。